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LDO的應用非常簡單,很多LDO僅需在輸入端及輸出端各接一顆電容即可穩定工作。在LDO的應用中需要考慮壓差、靜態電流、PSRR等重要參數。在以電池作為電源的系統中,應當選擇壓差盡量低的LDO,這樣可以使電池較長時間為系統供電,比如NCP600,NCP629等等。靜態電流Iq是Iquiescent的縮寫,指芯片自身所消耗的電流。在一些低功耗應用中,應當盡量選擇Iq小的LDO。一些工程師在設計低功耗系
FPGA采用了邏輯單元陣列LCA(Logic Cell Array)這樣一個概念,內部包括可配置邏輯模塊CLB(Configurable Logic Block)、輸入輸出模塊IOB(Input Output Block)和內部連線(Interconnect)三個部分。 現場可編程門陣列(FPGA)是可編程器件,與傳統邏輯電路和門陣列(如PAL,GAL及CPLD器件)相比,FPGA具有不同的結構。
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1. LDO是啥LDO是low dropout regulator的通稱,即低電壓差線形穩壓器,這也是比較于傳統的的線形穩壓器而言的,傳統式的穩壓器,鍵入比輸出要**許多,不然沒法工作中,LDO很有可能鍵入比輸出高1~2V就可以。LDO低電壓差,主要是內部應用PMOS管,一般的線形穩壓器應用的是PNP三極管,PMOS是工作電壓推動,不用電流,大大減少LDO自身耗費的電流;一般的穩壓器為了避免PNP
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